• 每天进步一点点------基础实验_01_多路复用器 :4通道8位带三态输出


     1 /*********************************************************************************
     2 * Company                    : 
     3 * Engineer                    : 空气微凉
     4 * 
     5 * Create Date                : 00:00:00 22/03/2013 
     6 * Design Name                : 
     7 * Module Name                :         
     8 * Project Name                :  
     9 * Target Devices            : 
    10 * Tool versions            : 
    11 * Description                :  
    12 *                                   http://www.cnblogs.com/kongqiweiliang/             
    13 * Dependencies                : 
    14 *                                    
    15 * Revision                    : 
    16 * Revision                    : 0.01 - File Created
    17 * Additional Comments    : 基础实验_01_多路复用器   :4通道8位带三态输出 
    18 ********************************************************************************/
    19 `timescale 1ns/1ps
    20 `define    UD  #1
    21 /*******************************************************************************/
    22 module MUX_4_8    
    23 ( 
    24     //Interface package
    25     input                        [1:0]        iDAT_SEL        ,//
    26     input                        [7:0]        iDAT_EN        ,//
    27     input                        [7:0]        iDAT_0        ,//
    28     input                        [7:0]        iDAT_1        ,//
    29     input                        [7:0]        iDAT_2        ,//
    30     input                        [7:0]        iDAT_3        ,//
    31     output                    [7:0]        oDAT             //
    32 );  
    33 //-------------------------------------------------------------------------------
    34 reg  [7:0]  DAT_REG;
    35 always@(*)begin
    36     case(iDAT_SEL)
    37         2'b00        : DAT_REG = iDAT_0;
    38         2'b01        : DAT_REG = iDAT_1;
    39         2'b10        : DAT_REG = iDAT_2;
    40         2'b11     : DAT_REG = iDAT_3;
    41         default     : DAT_REG = 8'hZ;
    42     endcase
    43 end
    44 
    45 assign oDAT = iDAT_EN ? DAT_REG : 8'hZ;
    46 //-------------------------------------------------------------------------------
    47 endmodule 
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  • 原文地址:https://www.cnblogs.com/kongqiweiliang/p/3246135.html
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